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IC验证工程师

12000-20000
西咸- | 1年以上经验 | 本科学历
2021-05-29 更新 被浏览:
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GRAHAM CURREN 人事部
最近在线时间:2021-05-24 22:05
电话:029 ****9917 企业设置登录用户才能查看联系方式 立即登录
地址:西安市二环南路西段64号凯德广场23层(0)03/04号 查看上班路线
职位描述
招聘人数:3-4人 到岗时间:1个月之内 年龄要求:35岁以下 婚况要求:未婚 BS or MS with 2 years work experience. Complex and large-scale SOCSubsystemIPASIC DesignIntegrationVerification experiences. Strong knowledge of ARM Processor or Industry bus standard (PCI-e HT USB AMBA) or MultimediaVideoGPUDDR is preferred. Good knowledge of UVMOVMVMM is a plus. Good knowledge of VerilogCCSystem CSystemVerilog. Solid background of random techniques coverage-driven verification environment with SVAPSL assertions. Strong ability of scripting languages such as Perl Python Makefile C Shell. Familiar with EDA tools i.e. Synopsys VCS Cadence IUS Mentor QuestaSim Spyglass . . . Low-power designimplementationsimulation flow with UPFCPF. The ability to do Digital-Analog-Mixed simulations and develop UVM AMS models. Experience of tape-out using 40nm or advanced technology is plus. Strong cooperation skills and communication skills with the ability to convey complex technical concepts to other designverification peers in verbal or written form. Able to take multi-assignments from different customersTeams. 理学学士或硕士,2年工作经验。 复杂、大规模SOCSubsystemIPASIC DesignIntegrationVerification经验。熟悉ARM 处理器知识或工业总线标准 (PCI-e HT USB AMBA) 或MultimediaVideoGPUDDR者优先。 掌握UVMOVMVMM者优先。 掌握VerilogCCSystem CSystem Verilog。 扎实的随机技术知识,用SVAPSL搭建的以覆盖率为导向的验证环境。 较强的处理脚本语言的能力,如:Perl Python Makefile C Shell。 熟悉EDA工具,如:Synopsys VCS Cadence IUS Mentor QuestaSim Spyglass等。 用UPFCPF实现低功耗设计实现仿真。 能够进行数字模拟混合仿真及开发UVM AMS模型。 有40纳米流片经验或更高级技术经验者优先。 较强的团队协作能力和沟通技巧,可用口头或书面形式向设计验证的同事沟通复杂技术概念。 可在不同客户团队中完成多项任务工作。
求职提醒:求职过程请勿缴纳费用,谨防诈骗!若信息不实请举报。
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